SPEAR1340 datasheet(4/200 Pages) STMICROELECTRONICS

4 / 200 page

Contents

SPEAr1340

4/200

Doc ID 023063 Rev 4

4.1

Absolute maximum ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 132

4.2

Recommended operating conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . 133

4.3

Clocking parameters . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134

4.3.1

Master clock (MCLK) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 134

4.3.2

Real-time clock (RTC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 136

4.4

I/O AC/DC characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 138

4.4.1

3V3/2V5/1V8 I/O buffers (IOTYPE1/IOTYPE2/IOTYPE3) . . . . . . . . . . 138

4.4.2

IOTYPE4 I/O buffers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 142

4.4.3

DDR2 and DDR3 mode I/O buffers . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

4.5

Voltage regulator characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146

4.6

MiPHY characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146

4.7

Required external components . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 147

4.8

Power-up sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

4.9

Power-down sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

4.10

Reset release . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

4.11

ADC electrical characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

Timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 151

5.1

Reset timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 151

5.2

ADC timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 152

5.3

Cortex-A9 JTAG/trace timing characteristics . . . . . . . . . . . . . . . . . . . . . 152

5.3.1

Cortex-A9 JTAG timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . 152

5.3.2

Cortex-A9 trace timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . 153

5.4

CAM timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 154

5.5

CLCD timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 156

5.6

FSMC timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 157

5.6.1

NAND Flash configuration timing characteristics . . . . . . . . . . . . . . . . . 157

5.6.2

NOR Flash configuration timing characteristics . . . . . . . . . . . . . . . . . . 159

5.6.3

SRAM configuration timing characteristics . . . . . . . . . . . . . . . . . . . . . 162

5.7

GMAC timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

5.7.1

GMII transmit timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

5.7.2

GMII receive timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . 165

5.7.3

MII transmit timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . 165

5.7.4

MII receive timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 166

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