SPEAR320 datasheet(4/73 Pages) STMICROELECTRONICS

4 / 73 page

Contents

SPEAr320

4/73

Doc ID 16755 Rev 5

7.1

External interrupt timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . 50

7.2

Reset timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50

7.3

DDR2 timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50

7.3.1

DDR2 read cycle timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51

7.3.2

DDR2 write cycle timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51

7.3.3

DDR2 command timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 52

7.4

CLCD timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53

7.5

I2C timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

7.6

FSMC timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 55

7.6.1

NAND Flash configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 55

7.7

EMI timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

7.8

SDIO timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 59

7.9

MII Ethernet MAC 10/100 Mbps timing characteristics . . . . . . . . . . . . . . 60

7.9.1

MII transmit timing specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 60

7.9.2

MII receive timing specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 60

7.9.3

MDIO timing specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61

7.10

SMII Ethernet MAC timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . 61

7.11

SMI - Serial memory interface timing characteristics . . . . . . . . . . . . . . . . 62

7.12

SSP timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

7.12.1

SPI master mode timings (clock phase = 0) . . . . . . . . . . . . . . . . . . . . . 64

7.12.2

SPI master mode timings (clock phase = 1) . . . . . . . . . . . . . . . . . . . . . 65

7.13

UART timing characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66

7.14

ADC characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67

Package information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 68

Revision history . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70

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